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Determina si el equipo actual admite la característica de procesador especificada.
Syntax
BOOL IsProcessorFeaturePresent(
[in] DWORD ProcessorFeature
);
Parámetros
[in] ProcessorFeature
Característica de procesador que se va a probar. Este parámetro puede ser uno de los siguientes valores.
| Importancia | Meaning |
|---|---|
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Las instrucciones atómicas de carga y almacenamiento de 64 bits están disponibles. |
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Las instrucciones de división están disponibles. |
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La caché externa está disponible. |
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La instrucción de multiplicación y acumulación de punto flotante está disponible. |
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El banco de registro VFP/Neon: 32 x 64 bits está presente. Esta marca tiene el mismo significado que PF_ARM_VFP_EXTENDED_REGISTERS. |
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El conjunto de instrucciones 3D-Now está disponible. |
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Los canales de procesador están habilitados. |
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La operación de comparación atómica e intercambio (cmpxchg) está disponible. |
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La operación de comparación atómica e intercambio de 128 bits (cmpxchg16b) está disponible.
Windows Server 2003 y Windows XP/2000: Esta característica no se admite. |
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La operación de comparación atómica de 64 e intercambio de 128 bits (cmp8xchg16) está disponible.
Windows Server 2003 y Windows XP/2000: Esta característica no se admite. |
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_fastfail() está disponible. |
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Las operaciones de punto flotante se emulan mediante un emulador de software.
Esta función devuelve un valor distinto de cero si se emulan las operaciones de punto flotante; de lo contrario, devuelve cero. |
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En un Pentium, un error de precisión de punto flotante puede producirse en raras circunstancias. |
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El conjunto de instrucciones MMX está disponible. |
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La prevención de ejecución de datos está habilitada. Windows XP/2000: Esta característica no se admite hasta Que Windows XP con SP2 y Windows Server 2003 con SP1. |
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El procesador está habilitado para PAE. Para obtener más información, vea Extensión de dirección física.
Todos los procesadores x64 siempre devuelven un valor distinto de cero para esta característica. |
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La instrucción RDTSC está disponible. |
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Las instrucciones de RDFSBASE, RDGSBASE, WRFSBASE y WRGSBASE están disponibles. |
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La traducción de direcciones de segundo nivel es compatible con el hardware. |
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El conjunto de instrucciones SSE3 está disponible.
Windows Server 2003 y Windows XP/2000: Esta característica no se admite. |
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El conjunto de instrucciones SSSE3 está disponible. |
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El conjunto de instrucciones SSE4_1 está disponible. |
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El conjunto de instrucciones SSE4_2 está disponible. |
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El conjunto de instrucciones avX está disponible. |
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El conjunto de instrucciones AVX2 está disponible. |
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El conjunto de instrucciones AVX512F está disponible. |
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La virtualización está habilitada en el firmware y está disponible por el sistema operativo. |
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El conjunto de instrucciones SSE está disponible. |
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El conjunto de instrucciones SSE2 está disponible.
Windows 2000: Esta característica no se admite. |
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El procesador implementa las instrucciones XSAVE y XRSTOR.
Windows Server 2008, Windows Vista, Windows Server 2003 y Windows XP/2000: Esta característica no se admite hasta Windows 7 y Windows Server 2008 R2. |
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Este procesador Arm implementa el conjunto de instrucciones de Arm v8. |
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Este procesador Arm implementa las instrucciones criptográficas adicionales de Arm v8 (por ejemplo, AES, SHA1 y SHA2). |
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Este procesador Arm implementa las instrucciones extra CRC32 de Arm v8. |
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Este procesador Arm implementa las instrucciones atómicas de Arm v8.1 (por ejemplo, CAS, SWP). |
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Este procesador Arm implementa las instrucciones de DP de Arm v8.2 (por ejemplo, SDOT, UDOT). Esta característica es opcional en implementaciones de Arm v8.2 y obligatorias en implementaciones de Arm v8.4. |
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Este procesador Arm implementa las instrucciones de JSCVT de Arm v8.3 (por ejemplo, FJCVTZS). |
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Este procesador Arm implementa las instrucciones LRCPC de Arm v8.3 (por ejemplo, LDAPR). Tenga en cuenta que ciertas CPU de Arm v8.2 pueden admitir opcionalmente las instrucciones LRCPC. |
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Este procesador Arm implementa las instrucciones de SVE (extensión de vector escalable) (FEAT_SVE). |
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Este procesador Arm implementa las instrucciones de SVE2 (FEAT_SVE2). |
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Este procesador Arm implementa las instrucciones de SVE2.1 (FEAT_SVE2p1). |
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Este procesador Arm implementa las instrucciones de AES de SVE (FEAT_SVE_AES). |
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Este procesador Arm implementa las instrucciones largas de multiplicación polinómica de 128 bits de SVE (FEAT_SVE_PMULL128). |
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Este procesador Arm implementa las instrucciones de permute de bits SVE (FEAT_SVE_BitPerm). |
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Este procesador Arm implementa las instrucciones de SVE BF16 (BFloat16) (FEAT_BF16). |
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Este procesador Arm implementa las instrucciones SVE EBF16 (Extended BFloat16) (FEAT_EBF16). |
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Este procesador Arm implementa las instrucciones de SVE B16B16 (FEAT_SVE_B16B16). |
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Este procesador Arm implementa las instrucciones criptográficas SVE SHA-3 (FEAT_SVE_SHA3). |
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Este procesador Arm implementa las instrucciones criptográficas de SVE SM4 (FEAT_SVE_SM4). |
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Este procesador Arm implementa las instrucciones de SVE I8MM (multiplicación de matriz Int8) (FEAT_I8MM). |
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Este procesador Arm implementa las instrucciones de la matriz SVE F32MM (FP32 matrix multiply) (FEAT_F32MM). |
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Este procesador Arm implementa las instrucciones de la matriz SVE F64MM (FP64 matrix multiply) (FEAT_F64MM). |
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Este procesador x64 implementa el conjunto de instrucciones DE IMC2. |
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Este procesador x64 implementa la instrucción MOVDIR64B. |
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Este procesador Arm implementa las instrucciones atómicas LSE2 (FEAT_LSE2). |
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Este procesador Arm implementa las instrucciones criptográficas SHA-3 (FEAT_SHA3). |
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Este procesador Arm implementa las instrucciones criptográficas SHA-512 (FEAT_SHA512). |
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Este procesador Arm implementa las instrucciones NEON de I8MM (matriz Int8 multiplique) (FEAT_I8MM). |
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Este procesador Arm implementa las instrucciones NEON de FP16 (punto flotante de precisión media) (FEAT_FP16). |
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Este procesador Arm implementa las instrucciones NEON de BF16 (BFloat16) (FEAT_BF16). |
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Este procesador Arm implementa las instrucciones NEON de EBF16 (Extended BFloat16) (FEAT_EBF16). |
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Este procesador Arm implementa las instrucciones de SME (extensión de matriz escalable) (FEAT_SME). |
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Este procesador Arm implementa las instrucciones SME2 (FEAT_SME2). |
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Este procesador Arm implementa las instrucciones SME2.1 (FEAT_SME2p1). |
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Este procesador Arm implementa las instrucciones SME2.2 (FEAT_SME2p2). |
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Este procesador Arm implementa las instrucciones de AES de SVE cuando se encuentra en modo SVE de streaming (FEAT_SSVE_AES). |
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Este procesador Arm implementa las instrucciones de permute de bits SVE cuando se encuentra en modo SVE de streaming (FEAT_SSVE_BitPerm). |
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Este procesador Arm implementa la instrucción SVE FMMLA (ampliación, 4 vías, FP8 a FP16) cuando está en modo SVE de streaming (FEAT_SSVE_F8F16MM). |
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Este procesador Arm implementa la instrucción SVE FMMLA (ampliación, 8 vías, FP8 a FP32) cuando está en modo SVE de streaming (FEAT_SSVE_F8F32MM). |
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Este procesador Arm implementa las instrucciones de FP8DOT2 SVE2 cuando se encuentra en modo SVE de streaming (FEAT_SSVE_FP8DOT2). |
|
Este procesador Arm implementa las instrucciones de FP8DOT4 SVE2 cuando se encuentra en modo SVE de streaming (FEAT_SSVE_FP8DOT4). |
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Este procesador Arm implementa las instrucciones de SVE2 FP8FMA cuando se encuentra en modo SVE de streaming (FEAT_SSVE_FP8FMA). |
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Este procesador Arm implementa las instrucciones de SME F8F32 (FEAT_SME_F8F32). |
|
Este procesador Arm implementa las instrucciones de SME F8F16 (FEAT_SME_F8F16). |
|
Este procesador Arm implementa las instrucciones de SME F16F16 (FEAT_SME_F16F16). |
|
Este procesador Arm implementa las instrucciones de SME B16B16 (FEAT_SME_B16B16). |
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Este procesador Arm implementa las instrucciones de SME F64F64 (FEAT_SME_F64F64). |
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Este procesador Arm implementa las instrucciones de SME I16I64 (FEAT_SME_I16I64). |
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Este procesador Arm implementa las instrucciones de LUTv2 de SME (FEAT_SME_LUTv2). |
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Este procesador Arm implementa SME FA64 (conjunto completo de instrucciones AArch64 cuando está en modo SVE de streaming) (FEAT_SME_FA64). |
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Este procesador x64 implementa la instrucción UMONITOR. |
Valor devuelto
Si se admite la característica, el valor devuelto es un valor distinto de cero.
Si no se admite la característica, el valor devuelto es cero.
Si hal no admite la detección de la característica, independientemente de si el hardware admite o no la característica, el valor devuelto también es cero.
Observaciones
La compatibilidad con PF_SSSE3_INSTRUCTIONS_AVAILABLE a través PF_AVX512F_INSTRUCTIONS_AVAILABLE de se agregó en Windows SDK (19041) y es compatible con Windows 10, versión 2004 (actualización de mayo de 2020) o posterior.
Se agregó compatibilidad con PF_ERMS_AVAILABLE, PF_ARM_V82_DP_INSTRUCTIONS_AVAILABLEy PF_ARM_V83_JSCVT_INSTRUCTIONS_AVAILABLE en Windows SDK (20348) y son compatibles con Windows 11 y Windows Server 2022.
La definición PF_ARM_V83_LRCPC_INSTRUCTIONS_AVAILABLE se agregó en Windows SDK (22621) y es compatible con Windows 11, versión 22H2.
Se agregó compatibilidad con PF_ARM_SVE_INSTRUCTIONS_AVAILABLE a través PF_MOVDIR64B_INSTRUCTION_AVAILABLE y PF_ARM_SHA3_INSTRUCTIONS_AVAILABLE a través PF_ARM_V86_EBF16_INSTRUCTIONS_AVAILABLE de Windows SDK (26100) y son compatibles con Windows 11, versión 24H2 y Windows Server 2025 o posterior.
Requisitos
| Requirement | Importancia |
|---|---|
| Cliente mínimo compatible | Windows 2000 Professional [aplicaciones de escritorio | Aplicaciones para UWP] |
| Servidor mínimo admitido | Windows 2000 Server [aplicaciones de escritorio | Aplicaciones para UWP] |
| de la plataforma de destino de |
Windows |
| Header | processthreadsapi.h (incluya Windows.h) |
| Library | Kernel32.lib |
| DLL de | Kernel32.dll |